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L'école d'ingénieur en systèmes avancés et réseaux

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Conception d'architectures numériques complexes sur cible FPGA - 4AMCE410

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  • Volumes horaires

    • CM : 12.0
    • TD : 6.0
    • TP : 9.0
    • Projet : -
    • Stage : -
    • DS : -
    Crédits ECTS : 2.5
  • Responsables : Vincent BEROULLE

Objectifs

A la fin du cours, l'étudiant sera capable de concevoir en VHDL un système numérique complexe sur composants reconfigurables (CPLD ou FPGA).

Contenu

Chapitres du cours

  1. Introduction
    1. Pourquoi utiliser les composants reprogrammables ?
    2. Flot de conception
    3. Signal vs. variable
  2. Conception de systèmes synchrones et GALS
    1. Conception de systèmes GALS
    2. Métastabilité et transmission de signaux entre domaines d'horloge
  3. Méthodes de synthèse RTL
    1. Directives de synthèse (partage de ressources, choix du codage...)
    2. Conception régulière
    3. Conception aléatoire (description de machines à états)
    4. Conception RTL : de l'algorithme à l'ASMD
  4. Traitement du signal sur FPGA

Travaux pratiques

  1. Application de la méthode de conception RTL sur cible Xilinx (Spartan3E)

Prérequis

Simulation et synthèse logique VHDL, architecture des composants reconfigurables (CPLD, FPGA), opérateurs arithmétiques, machines à états (Moore, Mealy), architecture des ordinateurs, langage C

Contrôles des connaissances

E1 = Examen terminal de session 1 : Ecrit 1h30, un seul document autorisé "VHDL quick reference card", sans calculatrice
TP = Moyenne des 2 TP
CC = Moyenne de contrôle continu (devoirs surveillés, devoir à la maison)
E2 = Examen terminal de session 2 : Ecrit 1h30, un seul document autorisé "VHDL quick reference card", sans calculatrice

Calendrier

Le cours est programmé dans ces filières :

cf. l'emploi du temps 2020/2021

Informations complémentaires

Code de l'enseignement : 4AMCE410
Langue(s) d'enseignement : FR

Le cours est rattaché aux structures d'enseignement suivantes :

Vous pouvez retrouver ce cours dans la liste de tous les cours.

Bibliographie

RTL Hardware design using VHDL, coding for efficiency, portability and scalability, Pong. P. CHU, WILEY INTERSCIENCE

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mise à jour le 25 juin 2015

Université Grenoble Alpes